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FPGA數字通信創新實驗平臺(基于Xilinx)
發布日期:2016-10-9
一、系統介紹
本實驗箱采用Spartan-6系列的FPGA作為核心器件。Spartan-6系列的FPGA 擁有豐富的邏輯資源,并集成眾多的DSP48A資源,可以滿足復雜DSP算法的需求。平臺板載DDR3存儲芯片,以及高性能可任意配置的時鐘芯片,同時提供雙通道的高性能可配置DA/AD芯片及中頻VGA,支持中頻輸入/輸出。平臺集成雙路基帶DA/AD,支持零/低中頻輸入/輸出
二、硬件構成
1)  FPGA:XC6SLX45T Spartan-6
  (1) 43,661個可編程邏輯單元
  (2) 2,088Kb Block RAM Blocks
  (3) 58個DSP48A單元
  (4) 4個時鐘管理模塊
2) 存儲器:
  (1) 1Gb DDR3 SDRAM
  (2) 32Mb SPI FLASH
3) 中頻DAC/ADC:
  (1) 雙通道 12-Bit 250MSPS DACs,SMA接口
  (2) 雙通道 12-Bit 125MSPS ADCs,SMA接口
  (3) TXDACs Path Inter polation by 2x or 4x
  (4) RXADCs Path Decimation by 2
4) 中頻VGA:
  (1) 可調增益范圍:–2.5 dB to +42.5 dB
  (2) 3dB截止頻率500MHz
5)時鐘技術:
  (1) 10MHz參考時鐘輸出,SMA接口
  (2) 用于外部參考時鐘輸入,SMA接口
  (3) 板載10MHz高穩定度有源晶振
  (4) 板載高性能時鐘芯片,產生高頻時鐘源
6)基帶DAC/ADC:
  (1) 雙通道 10-Bit 125MSPS DACs,BNC接口(可對接選配射頻盒)
  (2) 雙通道 10-Bit 40MSPS  ADCs,BNC接口(可對接選配射頻盒)
7)人機交互接口:
  (1) TFT液晶屏(800×480)
  (2) RS232串口
  (3) 6個LED,4個按鍵,16位撥碼開關
  (4) JTAG調試口
  (5) 擴展I/O接口
  (6) 測試I/O接口
三、軟件構成
    1、硬件平臺測試代碼
     (1)TFT顯示屏測試代碼;
     (2)時鐘芯片配置測試代碼;
     (3)DDR3數據存儲測試代碼;
     (4)中頻AD/DA、VGA閉環測試代碼;
     (5)基帶AD/DA閉環測試代碼;
    2、數字通信實驗系列
     (1)FPGA中的數字信號處理基礎實驗;
     (2)DQPSK系統的發送端設計;
     (3)DQPSK系統的接收端設計;
     (4)OFDM系統的發送端設計;
     (5)OFDM系統的接收端設計;
    3、簡易移動通信衰落信道實驗系列
     (1)瑞利/萊斯衰落信道模擬實驗;
     (2)多徑及多普勒頻移信道模擬實驗;
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